Lint檢查
關注創建者：匿名 創建時間：2026-03-16
Lint檢查的實例教程
3月20日，新思科技芯課程AI系列主題第三講即將推出：「基于大語言模型的VC SpyGlass Lint Advisor流程與應用」，將介紹GenAI技術和傳統Lint流程相結合的新技術--VC SpyGlass Lint Advisor。該技術不僅能理解Lint報錯的原因并提供精準的代碼修復建議，還能通過自然語言描述來滿足定制化Lint檢查的需求；另外它還能通過自然語言描述直接生成期望的waiver來過濾掉不期望看到的違例。采用該技術能加快 Lint違例的修復和收斂的效率，從而極大解放開發者的生產力。
GenAI+Lint全新技術：VC SpyGlass Lint Advisor實戰課程即將上線，歡迎大家報名！
時間：3月 20日（星期五），14:00–15:00
地點：線上直播
講師簡介：
羅木江 | 新思科技首席應用工程師
負責數字電路驗證系列產品的支持，在RTL Signoff靜態驗證領域以及跨技術域驗證方法學具有豐富的經驗。
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展開 3月20日，新思科技芯課程AI系列之「基于大語言模型的VC SpyGlass Lint Advisor流程與應用」正式開講！感興趣的下滑預約學習??
時間：3月20日 周五，14：00-15：00
內容簡介：
本課程旨在介紹GenAI技術和傳統Lint流程相結合的新技術——VC SpyGlass Lint Advisor。該技術不僅能理解Lint報錯的原因并提供精準的代碼修復建議，還能通過自然語言描述來滿足定制化Lint檢查的需求；另外它還能通過自然語言描述直接生成期望的waiver來過濾掉不期望看到的違例。采用該技術能加快Lint違例的修復和收斂的效率，從而極大解放開發者的生產力。
講師介紹：
形式：線上
參與方式：下方掃碼免費報名
技術鄰簡介：
技術鄰專注于工科技術社區，從最早的CAE技術社區（中國CAE聯盟）發展而來，在CAE領域有20年的教學和咨詢服務經驗。
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展開 該工作流的特點式由新思科技 EDA 智能體協同處理以下任務：根據自然語言和形式規范生成 RTL（寄存器傳輸級）代碼，運行 Lint 檢查以確保 RTL 的整潔性，生成單元級測試平臺（testbench），并最終通過 EDA 工具迭代運行驗證以收斂至目標指標。對于大型 SoC 設計而言，采用傳統方法，這一前端設計過程通常需要一個驗證團隊四到六個月的時間。而由新思科技 AgentEngineer 技術驅動的工作流已經幫助客戶將生產力提升了 2 倍，在部分案例中實現高達 5 倍的改善。
新思科技的智能體技術棧基于行業標準的 SDK 和 API 構建，可與現有客戶智能體和數據實現互操作。公司正與 AMD、微軟和英偉達等關鍵行業領導者合作，共同開發隨時間推移具備更高自動化水平的差異化智能體能力。新思科技目前正與客戶就這一多智能體工作流展開合作，并致力于為從設計到制造全流程提供更多的多智能體協同工作流。
新思科技發布 Ansys 2026 R1——收購完成后的首個重要 Ansys 產品發布
新思科技發布了業內最深、最廣仿真產品組合的最新功能更新，集成了材料智能、功能安全、光子設計及嵌入式系統的工作流。作為自收購完成以來的首個重要 Ansys 產品發布，R1 帶來了：
全新的人工智能智能體與生成式人工智能仿真能力，包括 Ansys Mechanical? 軟件中的 Mesh Agent 新功能；Ansys GeomAI，一款用于生成、評估和細化幾何概念的全新解決方案；以及 Discovery Validation Agent，一個能利用上下文智能與行業最佳實踐主動識別設置問題的人工智能智能體合作伙伴。
展開 除了RTL, 設計工程師還需要根據設計目標編寫SDC 和power intent, 并做對應的質量檢查。設計工程師需要使用大量EDA工具：
編輯器：VIM，emac；
Lint：RTL質量檢查，Spyglass，Jasper；
CDC：SDC質量檢查，Spyglass，Conformal，GCA;
CPF/1801：power intent質量檢查，CLP;
Power：RTL級功耗分析，Joules，PA；
仿真器：C，S，M三家都有各自的仿真工具;
綜合：Genus，DC；
老驢以為，從集成開始，由腦力勞作進入體力勞作，對比蓋房子，就是從設計師到泥瓦工。集成工程師，要把芯片所用的所有模塊相互連接起來，指導思想是架構工程師確定的，各個IP如何連接是各IP的owner確定的，集成工程師只要保證不多連、不少連、不亂連即可，據說當前也沒有什么有效的集成工具，常用到的是emac。
02
驗證
接著捋，實際項目中驗證跟綜合從RTL coding開始就會交叉進行，反復迭代。
驗證在數字芯片設計中占很大比例，近些年在設計復雜度的推動下驗證方法學跟驗證手段在不斷更新，從OVM到UVM，從Dynamic verification到Static verification, 從FPGA到Emulator，所有革新目的可概括為：快速、完備、易調試。
驗證涉及到許多方面，驗證工程師一方面要對相關協議算法有足夠了解，根據架構、算法工程師設定的目標設計仿真向量；另一方面要對設計本身足夠了解，以提高驗證效率，縮短驗證時間。驗證工程師需要掌握許多技術，需要使用許多工具。
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該工作流的特點式由新思科技 EDA 智能體協同處理以下任務：根據自然語言和形式規范生成 RTL（寄存器傳輸級）代碼，運行 Lint 檢查以確保 RTL 的整潔性，生成單元級測試平臺（testbench），并最終通過 EDA 工具迭代運行驗證以收斂至目標指標。對于大型 SoC 設計而言，采用傳統方法，這一前端設計過程通常需要一個驗證團隊四到六個月的時間。
該技術不僅能理解Lint報錯的原因并提供精準的代碼修復建議，還能通過自然語言描述來滿足定制化Lint檢查的需求；另外它還能通過自然語言描述直接生成期望的waiver來過濾掉不期望看到的違例。采用該技術能加快 Lint違例的修復和收斂的效率，從而極大解放開發者的生產力。
GenAI+Lint全新技術：VC SpyGlass Lint Advisor實戰課程即將上線，歡迎大家報名！
該技術不僅能理解Lint報錯的原因并提供精準的代碼修復建議，還能通過自然語言描述來滿足定制化Lint檢查的需求；另外它還能通過自然語言描述直接生成期望的waiver來過濾掉不期望看到的違例。采用該技術能加快Lint違例的修復和收斂的效率，從而極大解放開發者的生產力。
設計工程師需要使用大量EDA工具：
編輯器：VIM，emac；
Lint：RTL質量檢查，Spyglass，Jasper；
CDC：SDC質量檢查，Spyglass，Conformal，GCA;
CPF/1801：power intent質量檢查，CLP;
Power：RTL級功耗分析，Joules，PA；
仿真器：C，S，M三家都有各自的仿真工具;
綜合：
