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緩解的方法如下：減小地線的電阻，縮短模擬電路和數字電路共用地線，把模擬電路和數字電路通過磁珠隔離進一步壓制干擾，假如數字電路電流波動不變，依然是1A，共用的地的電阻降低到2 mΩ，此時數字電路在共地部分引起的電壓波動只有0.002*1=0.002V，比上面的20mV小了很多，同時，有磁珠的存在還會進一步壓制這個噪聲，提高模擬電路的信噪比或者是共模抑制比。

90、[問] 你好，請問ARM芯片提高電源的抗干擾，除了在電源輸入端接入TVS管之外，電源輸入端的輸入腳要接電感比較好，還是磁珠比較好？ [答] 一般會使用磁珠。 91、[問] pcb板在線能不能仿真一下，也就是怎么驗證下板子有沒有問題? [答] 有些PCB軟件可以做一些走線檢查和完整性分析，例如cadence。

◎晶振的電源單獨供電,通過磁珠加電容濾波電路，將時鐘供電電源與VCC在PCB上隔開，如圖2－10，供電電源由VCC經過磁珠Z6和電容C252（0.01u）和C253(1000pf)組成獨立的電源濾波電路，同樣的設計方法可以用于帶PLL時鐘分配器等電路。 ◎時鐘線應盡量走線在內層并少打過孔，保證時鐘與回流路徑的最小面積。